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基于PCI9054的PCI高速通信接口实现 - 通信-网络 - 免费猫

发布时间:2020-02-17 14:02:45 阅读: 来源:充填泵厂家

基于PCI9054的PCI高速通信接口实现 - 通信/网络 - 电子工程网

图2 PCI9054硬件连接电路图

3) PCI9054与PCI插槽信号连接

PCI9054与PCI插槽间的连接信号线,这些信号线包括地址数据复用信号AD[31:0],总线命令信号C/BE[3:0]和PCI协议控制信号PAR,FRAME#,IRDY#,TRDY#,STOP#,IDSEL,DEVSEL#等,电路连接中将彼此对应的信号线连接在一起即可。在PCI总线信号中.除了RST#。INTA#-INTD#之外,其他所有的信号都在始终上升沿被采样。每个信号都

有相对于时钟前沿建立和保持时间。在此期间,不允许有信号的跳动。该时间一过,信号的变化就无关紧要了。这种建立和保持时间对于不同的信号其情形是不同的。对于AD[31:0],PAR和IDSEL来说,只有在一定的十种边沿上才有上述时间的要求。对于LOCK#,IRDY#,TRDY#.FRAME#,DEVSEL#,STOP#,ⅢeQ#,GNT#,SERR#和PERR#这些信号在每个时钟前沿都有建立和保持时间。对于C/BE[3:0]#在传输总线命令是,要在FRAME#第一次建立时对应的时钟边沿上遵守建立和保持时间的关系。若传输字节使能信号时,要在完成一个地址期或数据期之后的每一个时钟边沿保证相应的建立和保持时间。

4) PCI9054与EEPROM接口

各种接口芯片都需要外接串行EEPROM芯片来加载配置数据.对于串行EEPROM芯片,需要根据接口芯片数据手册中给出的生产厂家及型号选择。这里选择FM93LC56。PCI9054提供4个管脚与串行EEPROM相连接,他们分别是EEDI,EEDO,EESK,EECS,对应于FM93LC56的DI,DO,SkCS这四个管脚,这4对管脚直接相连就可以,另外93Lc56的VCC管脚需要接+5V电源,GND接地。因为需要对串行EEPROM进行写操作,串行EEPROM应处于可编程而且非保护状态,所以PE接高电平而PRE接低电平。FM93LC56的技术手册规定两个管脚上拉和下拉的电阻应为10K左右。

5) PCI9054与LOCAL Bus端连接

LHOLD:申请使用本地总线,输出信号;LHOLDA:对LHOLD应答,输入信号;ADS:新的总线访问有效地址的开始,在总线访问first clock设置时,输出信号;BLAST:表示为总线访问的last transfer,输出信号;LW/R#:高电平表示读操作,低电平表示写操作,输出信号;LA:地址线;LD:数据线;READY:表示总线上读数据有效或写数据完成,用以连接PCI9054等待状态产生器,输入信号。

3 VeHiog HDL软件实现

FPGA内部在PCI9054本地总线LOCAL Bus基础之上进行设计;FPGA片内RAM或FIFO可以在QUARTUSII环境下利用利用工具MegaWizard Plug_In Manager调用功能模块生成。单双口、存储容量、数据总线的宽度以及同步或异步自行定制。为与MCU或DSP等处理器通信,要设计RAM访问仲裁模块。决定某一时刻对RAM访问的主方;PCI9054支持单周期、突发和DMA传输,在FPGA内部要设计本地端总线控制模块,实现局部总线的状态控制,同时产生FPGA片内RAM的读写时序及地址信号。

PCI9054支持单周期、突发传输和DMA传输,因此在状态机设计中不仅要满足单周期传输的时序。还要兼顾突发和DMA传输时序。依据FCl9054的datasheet以及PCI总线协议,其状态转换图如图3所示:

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